北京速核電子科技有限公司主營：高速數(shù)據(jù)采集

高速數(shù)據(jù)采集時，遇到“混疊”和“幅度分辨率不足”怎么辦？

在使用模塊化數(shù)字化儀進(jìn)行測量時，重要的是要注意一些常見的設(shè)置問題，這些問題會導(dǎo)致數(shù)據(jù)不良和浪費(fèi)時間。本文將對“混疊”和“幅度分辨率不足”兩個問題提供深入解答。

混疊，采樣數(shù)據(jù)系統(tǒng)的普遍問題。自采樣數(shù)據(jù)采集系統(tǒng)出現(xiàn)以來，由于輸入信號采樣不足而引起的混疊問題就一直存在。采用較的數(shù)據(jù)儀器，如數(shù)字化儀和數(shù)字示波器，根據(jù)采樣定理，要求模擬信號的采樣頻率大于輸入端存在的較高頻率分量的兩倍。如果不滿足這個條件，就會產(chǎn)生混疊。當(dāng)前的數(shù)字轉(zhuǎn)換器設(shè)計(jì)通常包含大大超過模擬帶寬的較大采樣率。通過將其與長采集存儲器相結(jié)合，這些數(shù)字化器較小化了這個經(jīng)典問題。 但是，用戶應(yīng)該注意混疊，尤其是在將采樣率編程為較低速度時。

采樣數(shù)據(jù)系統(tǒng)對輸入信號進(jìn)行采樣并存儲結(jié)果數(shù)字?jǐn)?shù)據(jù)。 如果采樣率滿足或超過采樣定理的規(guī)則，則可以重建信號而不丟失任何信息。如果模擬輸入波形的采樣頻率小于其較大頻率的兩倍，則數(shù)字采樣的重建結(jié)果會產(chǎn)生頻率低于原始頻率的波形。

幅度分辨率不足

數(shù)字轉(zhuǎn)換器使用模擬到數(shù)字轉(zhuǎn)換器(adc)將模擬信號的樣本轉(zhuǎn)換成數(shù)字值。ADC的分辨率是用于數(shù)字化輸入樣本的比特?cái)?shù)。對于一個n位ADC，可以產(chǎn)生的離散數(shù)字電平數(shù)為2n。因此，一個12位數(shù)字轉(zhuǎn)換器可以解決212或4096級。較小有效位(lsb)表示可以檢測到的較小間隔，對于12位數(shù)字轉(zhuǎn)換器，較小有效位為1/4096或2.4 x 10-4。為了將lsb轉(zhuǎn)換成電壓，我們?nèi)?shù)字化儀的輸入范圍除以2，提高到數(shù)字化儀的分辨率。

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高速數(shù)據(jù)采集存儲板卡設(shè)計(jì)

介紹所設(shè)計(jì)的高速數(shù)據(jù)采集高速、大容量存儲卡和系統(tǒng)實(shí)現(xiàn)方案。A/D采集采用8位的1 GHz A/D轉(zhuǎn)換芯片,高速大容量存儲采用固態(tài)存儲芯片F(xiàn)LASH(閃存)為存儲介質(zhì),FPGA(現(xiàn)場可編程門陣列)為存儲陣列的控制核心,針對來自A/D的高速數(shù)據(jù),引入多級流水和冗余校驗(yàn)技術(shù),能夠屏蔽FLASH的壞塊。實(shí)現(xiàn)了用高密度、相對低速的FLASH存儲器對高速實(shí)時數(shù)據(jù)的可靠存儲。另外,通過的橋接芯片PCI9656,可以很方便地實(shí)現(xiàn)同主機(jī)的高速的數(shù)據(jù)通信。

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數(shù)據(jù)采集模塊跟數(shù)據(jù)采集卡有什么區(qū)別？

在系統(tǒng)基本工作原理方面

應(yīng)用時，數(shù)據(jù)采集系統(tǒng)置于被監(jiān)控的設(shè)備處，通過傳感器對設(shè)備的電壓或者電流信號進(jìn)行采樣、保持，并送入A/D轉(zhuǎn)換器變成數(shù)字信號，然后將該信號送到FIFO中。當(dāng)FIFO中存放的數(shù)據(jù)到了一定數(shù)目時，由ARM7從FIFO中讀出，然后通過ARM7的以太網(wǎng)接口或者RS232送給上位機(jī)?？紤]到要監(jiān)控的設(shè)備可能會很多，所以設(shè)計(jì)了多路采集通道，他們經(jīng)過模擬開關(guān)后再進(jìn)入A/D轉(zhuǎn)換器。CPLD是整個系統(tǒng)的控制核心，他控制采集通道的切換、A/D轉(zhuǎn)換器的啟/停、轉(zhuǎn)換后的數(shù)據(jù)在FIFO中的存放地址發(fā)生器、產(chǎn)生中斷請求以通知ARM7讀取存放在FIFO中的數(shù)據(jù)等。